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Verilog代码生成
Verireason Qwen2.5 7b RTLCoder Verilog GRPO Reasoning Tb I1 GGUF
这是一个针对Verilog硬件描述语言优化的7B参数大语言模型，专注于RTL编码和推理任务，提供多种量化版本。
大型语言模型
Transformers
英语
V
mradermacher
1,081
2
Verireason Qwen2.5 7b RTLCoder Verilog GRPO Reasoning Tb GGUF
这是一个基于Qwen2.5-7b的量化模型，专注于Verilog代码生成和推理任务，采用了强化学习技术进行优化。
大型语言模型
Transformers
英语
V
mradermacher
413
1
Codev R1 Distill Qwen 7B
基于DeepSeek-R1蒸馏的Verilog RTL代码生成模型，在Verilog基准测试中表现优异
大型语言模型
Transformers
C
zhuyaoyu
154
2
Fine Tuned Codegen 16B Verilog
Openrail
VeriGen是基于CodeGen-multi-16B微调的16B参数模型，专门用于生成Verilog硬件描述语言代码。
大型语言模型
Transformers
其他
F
shailja
187
13
Fine Tuned Codegen 6B Verilog
Openrail
VeriGen是基于CodeGen-multi-16B微调的6B参数模型，专门用于生成Verilog硬件描述语言代码。
大型语言模型
Transformers
其他
F
shailja
131
2
Fine Tuned Codegen 2B Verilog
Openrail
VeriGen是一个基于CodeGen-multi-2B微调的20亿参数模型，专门用于生成Verilog硬件描述语言代码。
大型语言模型
Transformers
其他
F
shailja
511
8